maxwell_3d: Add tessellation mode register
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d2b50c5ebd
commit
707bf41c6f
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@ -491,6 +491,23 @@ public:
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INSERT_UNION_PADDING_WORDS(1);
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INSERT_UNION_PADDING_WORDS(1);
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};
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};
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enum class DepthMode : u32 {
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MinusOneToOne = 0,
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ZeroToOne = 1,
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};
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enum class TessellationPrimitive : u32 {
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Isolines = 0,
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Triangles = 1,
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Quads = 2,
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};
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enum class TessellationSpacing : u32 {
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Equal = 0,
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FractionalOdd = 1,
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FractionalEven = 2,
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};
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struct RenderTargetConfig {
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struct RenderTargetConfig {
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u32 address_high;
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u32 address_high;
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u32 address_low;
|
u32 address_low;
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@ -628,7 +645,16 @@ public:
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};
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};
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} sync_info;
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} sync_info;
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INSERT_UNION_PADDING_WORDS(0x11E);
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INSERT_UNION_PADDING_WORDS(0x15);
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union {
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BitField<0, 2, TessellationPrimitive> prim;
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BitField<4, 2, TessellationSpacing> spacing;
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BitField<8, 1, u32> cw;
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BitField<9, 1, u32> connected;
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} tess_mode;
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INSERT_UNION_PADDING_WORDS(0x108);
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u32 tfb_enabled;
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u32 tfb_enabled;
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@ -1388,6 +1414,7 @@ ASSERT_REG_POSITION(upload, 0x60);
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ASSERT_REG_POSITION(exec_upload, 0x6C);
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ASSERT_REG_POSITION(exec_upload, 0x6C);
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ASSERT_REG_POSITION(data_upload, 0x6D);
|
ASSERT_REG_POSITION(data_upload, 0x6D);
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||||||
ASSERT_REG_POSITION(sync_info, 0xB2);
|
ASSERT_REG_POSITION(sync_info, 0xB2);
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||||||
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ASSERT_REG_POSITION(tess_mode, 0xC8);
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ASSERT_REG_POSITION(tfb_enabled, 0x1D1);
|
ASSERT_REG_POSITION(tfb_enabled, 0x1D1);
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||||||
ASSERT_REG_POSITION(rt, 0x200);
|
ASSERT_REG_POSITION(rt, 0x200);
|
||||||
ASSERT_REG_POSITION(viewport_transform, 0x280);
|
ASSERT_REG_POSITION(viewport_transform, 0x280);
|
||||||
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